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https://repositorio.unifei.edu.br/jspui/handle/123456789/3788
Tipo: | Dissertação |
Título: | Implementação de um medidor de taxa de erro de bits com CRC utilizando linguagem VHDL |
Autor(es): | MIRANDA, Kelly de Pinho Miranda |
Primeiro Orientador: | LAMBERT-TORRES, Germano |
metadata.dc.contributor.advisor-co1: | PORTELINHA, Francisco Martins |
Resumo: | Este trabalho apresenta o projeto de um dispositivo de baixo custo para medir a taxa de erro de bits nos sistemas de comunicação de dados. Através da detecção dos erros ocorridos durante a transmissão dos dados em um certo intervalo de tempo, obtém-se a medida de taxa de erro de bits (“BER meter”). Este trabalho mostra também o programa desenvolvido em linguagem VHDL utilizando a ferramenta MAX+PLUS II, (versão 10.2, da Companhia ALTERA) que simula o funcionamento do dispositivo de medida de taxa de erro de bits proposto. |
Abstract: | This work presents the project of a device with a low cost to measure the bit error rate in data communications systems. Through the detention of the errors occurred during the transmission of the data in a certain interval of time, it is gotten measure it of bits error rate. This work also shows the program developed in VHDL language by using MAX+PLUS II tool, (version 10.2, of ALTERA Company) that simulates the functioning of measurer device bit error rate proposed. |
Palavras-chave: | Comunicações digitais Sistemas de comunicação Taxa de erro de bits Linguagem VHDL |
CNPq: | CNPQ::ENGENHARIAS::ENGENHARIA ELÉTRICA |
Idioma: | por |
País: | Brasil |
Editor: | Universidade Federal de Itajubá |
Sigla da Instituição: | UNIFEI |
metadata.dc.publisher.department: | IESTI - Instituto de Engenharia de Sistemas e Tecnologia da Informação |
metadata.dc.publisher.program: | Programa de Pós-Graduação: Mestrado - Engenharia Elétrica |
Tipo de Acesso: | Acesso Aberto |
URI: | https://repositorio.unifei.edu.br/jspui/handle/123456789/3788 |
Data do documento: | 7-Nov-2003 |
Aparece nas coleções: | Dissertações |
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